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Intel Rialto Bridge se anuncia como la próxima GPU de la marca para servidores

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Durante una conferencia en ISC 2022, feria dedicada a High Performance Computing (HPC), Intel oficializó la GPU para servidores Rialto Bridge, revelando los primeros detalles de la solución. Sucesora de Ponte Vecchio, el debut de la compañía en el segmento, la nueva solución trae cambios significativos en la arquitectura y promete ser la transición ideal para Falcon Shores, la primera generación de lo que la compañía llama XPU.

Intel Rialto Bridge es la próxima GPU para servidores de la marca

Intel se abstuvo de revelar muchos detalles técnicos sobre el Rialto Bridge, pero con la información difundida y las fotos publicadas del componente, es posible conocer algunos de los principales cambios que ofrecerá el próximo acelerador HPC de la marca. El primero de ellos es el aumento del número máximo de Xe Cores, que pasa de 128 a 160.

La imagen de la GPU muestra cómo Intel ha reorganizado las estructuras informáticas: los 128 núcleos Xe de Ponte Vecchio se distribuyeron en 16 chipsets con 8 núcleos Xe cada uno, mientras que el puente de Rialto solo utilizará 8 chipsets más largos, que parecen enviar 20 núcleos Xe cada uno. , con comunicación establecida por la memoria caché Rambo de alta velocidad de la empresa.

El nuevo acelerador Intel Rialto Bridge viene con hasta 160 Xe Cores, aumentos en el rendimiento y la eficiencia, y mayor ancho de banda de E/S.

Vale la pena señalar que los números aún son especulativos, ya que el gigante no detalló la arquitectura utilizada. Ni siquiera se sabe si se mantendrá la microarquitectura Xe-HPC, o si esta sería una sucesora, posiblemente llamada Xe²-HPC, pero está bastante claro que se ha reducido el número de chiplets utilizados para componer el acelerador, pasando de 47 a lo que parece ser un total de 31.

También se confirma que se utilizarán nuevas litografías para fabricar los chiplets, pero nuevamente no se dieron a conocer los procesos. Teniendo en cuenta la ventana de debut esperada de 2023, se puede especular con Intel 4 de 7nm y N5 y N4 de TSMC, 5nm y 4nm respectivamente, como posibles candidatos.

También según Intel, el Puente de Rialto debería ofrecer un rendimiento un 30 % mejor en escenarios del mundo real que el Ponte Vecchio, un salto respetable teniendo en cuenta la ventana de lanzamiento de un año entre los dos, aunque la mayoría de las ganancias deberían ser el resultado del 25 % de aumento % en el número de núcleos.

La GPU Rialto Bridge debería ser la última antes de la transición a las XPU Falcon Shores, que unen la CPU y la GPU en el mismo dado (Imagen: Divulgación / Intel)

El ancho de banda debería aumentar, aunque no está claro si se trata de un nuevo bus, como PCIe 6.0, o una nueva generación de Xe Link, que establece la comunicación entre la CPU y múltiples aceleradores, así como el consumo. Utilizando el nuevo zócalo OAM 2.0 (Open Accelerator Module 2.0), aún mantenido en secreto en este momento, cada Rialto Bridge alcanzaría 800W TGP.

El valor, uno de los más altos entre las GPU de servidor, es uno de los factores que alentaría a las empresas a reemplazar la refrigeración por aire con refrigeración líquida, respaldada por lanzamientos como la Nvidia A100 y la H100 refrigerada por agua. Se espera que se publiquen más detalles sobre Intel Rialto Bridge más adelante en el año a medida que se acerca 2023.

Intel Falcon Shores obtiene nuevos detalles

El gigante de Santa Clara también aprovechó para revelar más detalles sobre Intel Falcon Shores, la primera XPU de la compañía. El componente tiene la intención de unir las CPU Xeon y las GPU Xe-HPC en un solo zócalo, utilizando técnicas avanzadas de apilamiento de chiplets, llamadas por la marca de mosaico.

La idea es esencialmente mejorar el rendimiento y hacer que los aceleradores sean más escalables y personalizables para diferentes servidores, algo que AMD también planea hacer con un enfoque similar a través de las rumoreadas APU de exaescala de la familia Instinct MI300.

Las XPU Intel Falcon Shores tienen como objetivo revolucionar el segmento HPC al combinar CPU y GPU en un solo zócalo a través de chipsets combinados (Imagen: Folleto/Intel)

Anunciado en febrero, Falcon Shores se demostró en tres configuraciones: una con chiplets de CPU, otra con dos chiplets de CPU y dos chiplets de GPU, y otra con todos los chiplets de GPU: una configuración muy similar a la del Xeon Sapphire Rapids, para confiar en 4 chiplets, pero significativamente más avanzado. La promesa de flexibilidad sugiere que son posibles más configuraciones según las necesidades de la empresa que lo utilizará.

Algunos de los aspectos más destacados confirmados para el superacelerador incluyen la litografía de la era Angstrom, que indica el uso de Intel 20A (~2 nm) o Intel 18A (~1,8 nm), tecnologías de empaquetado avanzadas, posiblemente relacionadas con la adopción de una nueva generación del Tecnologías de apilamiento 2.5D EMIB y 3D Foveros de los chips gigantes y E/S líderes en la industria, que pueden incluir buses PCIe 6.0 y CXL.

La combinación de chipsets de CPU y GPU en un dado proporcionaría 5 veces más rendimiento/vatio, densidad de cómputo en x86 y capacidad de memoria y ancho de banda.

Según la compañía, en términos de rendimiento, todos los avances tecnológicos y la combinación de CPU y GPU en un solo socket ofrecerían 5 veces más rendimiento/vatio, 5 veces más densidad de cómputo en un solo socket x86 y 5 veces más capacidad y ancho de banda banda de memoria, números impresionantes considerando el pronóstico de estreno para 2024/2025.

Aparte de eso, uno de los grandes activos de Falcon Shores, diseñado para facilitar la transición a la arquitectura unificada, es el uso de OneAPI, el conjunto de soluciones de software de la empresa que permite la programación única para CPU, GPU y XPU. La ambición de Intel con esta suite de desarrollo es hacer la vida más fácil a los programadores, ya que el propio código sería el responsable de seleccionar qué parte del hardware debería ejecutarlo para obtener los mejores resultados.

Xeon Sapphire Rapids con HBM obtiene datos de rendimiento

La jornada finalizó con la presentación de nuevos datos de rendimiento de los procesadores Sapphire Rapids con HBM, pertenecientes a la 4ª generación de la familia Intel Xeon Scalable. Como sugiere el nombre de la serie de modelos, lo más destacado de los componentes es la adición de hasta 64 GB de memoria HBM2e en el chip, junto con los chips de procesamiento.

Esta memoria actúa como una especie de caché turboalimentada, reduciendo los accesos a la RAM del sistema y mejorando drásticamente el rendimiento en aplicaciones sensibles a la latencia resultante de este proceso.

Según Intel, los procesadores Xeon Sapphire Rapids con HBM serían más de 3 veces más rápidos que la actual familia Ice Lake-SP de primera línea, el Xeon Platinum 8380.

Usando pruebas seleccionadas y comparando los resultados con el rendimiento de un Xeon Platinum 8380 Xeon Scalable Ice Lake-SP de tercera generación de primera línea, los chips Sapphire Rapids con HBM serían más de 3 veces más rápidos en áreas de procesamiento como energía y física de simulación y más del doble de rápido en pronóstico del tiempo y fabricación mecánica, todo sensible a la latencia.

Junto con los modelos tradicionales, se espera que la serie Sapphire Rapids con HBM de la familia Xeon Scalable de cuarta generación debute oficialmente a finales de este año, con una alineación sucesora, Emerald Rapids, en 2023.

Fuente: Intel, AnandTech (1, 2), WCCFTech

Tommy Banks
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